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发信人: wjn (山东季风), 信区: Communication
标题: 高速系统的接地策略与电源抗干扰研究
发信站: BBS 哈工大紫丁香站 (Tue Nov 8 09:36:48 2005)

1 接地策略
在实时高速控制系统中,维持一低阻抗、大面积地是至关重要的。地线层不仅为高频电流充
当着一低阻抗回路径,而且也使ＥＭＩ/ＲＦＩ辐射最小化。由于线层的屏蔽作用,使得电路
对外部ＥＭＩ/ＲＩＦ的灵敏度也会降低。

1．1　印制电路板(ＰＣＢ)上的地线处理
系统中的每个ＰＣＢ应至少有一个地线层。理论上一个双面板应该将一面作为地层线,而另
一面作相互连接用,但在实际中,这是不可能的,因为地线层中的局部要用于信号和电源的交
叉及过孔。尽管如此,保留区域应尽可能大,至少为75%,同时应确保没有被单独隔离的地层
区域。板上ＩＣ的接地引脚应直接焊接到地线层以减少串行电感。电源端与地端应安装低
电感陶瓷表面贴片式退耦电容。如果采用引脚电容,其引脚必须小于1ｍｍ,同时也要求铁氧
体垫圈。在多板卡系统中,减小接地阻抗的最好方法是利用另一块ＰＣＢ作为底板(母板)以
实现各板之间的联接,因此要提供一个连续的地线层到母卡。ＰＣＢ连接器中有30～40%的
管脚分配给地线,而且这些引脚应该连接到底板的母卡上。底板上的地线层与机架地多点连
接,以扩散接地电流的返回路径。地线与金属机架之间良好的连接是至关重要的,要求自攻
金属螺钉或啮形垫圈。特别注意的是经阳极化处理的铝材机架,由于其表面是绝缘的。对于
具有大量数字电路的高速系统,要求从物理上将敏感的模拟器件与有噪声的数字器件分离,
且信号走线尽可能短。对于模拟、数字混合的ＰＣＢ板应有相互分离的地线,且二者不能相
义叉,以防止电容耦合。对于底板也要求模拟地与数字地分离。数字地、模拟地、电源地及
系统地之间的最终连接应采用多总线带或宽铜钉以减小电阻和感抗。每板的模、数地之间�
Σ⒔恿奖晨勘车男ぬ鼗�,以防板卡在插拔时在两地之间形成直流压差。只要注意系
统布局布线,防止信号间的相互干扰就可以减小噪声。如果使用地线层,在大多数情况下能
对灵敏信号的交叉起屏蔽作用。另外,系统中连接器上的所有信号走线必须采用并行方式,
以方便实现与地线引脚的分离,从而减小相互间的耦合;应尽量采用多地线引脚以减小信号
板和底板之间的地阻抗,实现信号线的分离。

1.2　模拟数字混合器件的地线处理
象运算放大器、基准源等模拟器件应与模拟地之间退耦,而ＡＤ、ＤＡＣ以及混合ＩＣ也应
看作模拟器件并与模拟件之间退耦。此类内部既有模拟电路又有数字电路的ＩＣ,由于数字
电流的迅速改变将产生一电压并无疑会通过分布电容耦合到模拟电路。同时在ＩＣ的引脚
之间不可避免地存在约0.2ＰＦ的分布电容,因此其模拟地与数字地通常保持分离以避免数
字信号耦合到模拟电路。然而,为防止进一步耦合,ＡＧＮＤ与ＤＧＮＤ应在外部以最短距
离连接到模拟地。在ＧＮＤ连接处任何额外的阻抗都将引起数字噪声,同理也将通过分布电
容耦合到模拟电路。ＩＣ的ＤＧＮＤ引脚告诉我们该引脚在内容连接到ＩＣ的数字地,而不
是指该引脚必须连接到系统的数字地。通过减小转换器数字端口的扇出,可以保持转换器在
瞬变状态逻辑转换的相对独立,也可以使任何进入转换器模拟端口的潜在耦合减少。为隔离
转74换器数据总线上的噪声,最好的办法是在其数据端口放置一缓冲锁存器。缓冲锁存器应
与另一数字电路共地,并且耦合到ＰＣＢ板的数字地线上。由于数字抗噪声度约为数百或数
千毫伏,因此数字地和模拟地之间的噪声减小应主要针对转换器的数字接口。模拟电路与数
字电路一般要求单独供电。转换器的电源管脚应该与模拟地之间接退耦电容,逻辑电路的电源引脚应与数字地之间退耦。如果数字供电电源相对没有干扰,也可用来作模拟电路的供
电电源,但这种应用应谨慎。

1.3　采样时钟电路的地线处理
采样时钟产生器电路也应考虑接地问题,并且与模拟地之间的退耦电容要更大一些。采样时
钟的相位噪声会降低系统的ＳＮＲ。由于采样时钟的抖动会调制输入信号,增加噪声并引起
基准畸变,因此应采用低相位噪声的晶振作为采样时钟。采样时钟产生器应与数字电路隔离
并退耦到模拟地。理论上在具有分散地的系统中,采样时钟产生器应以模拟地作为参考,然
而由于系统的各种制约,这种作法不总是能实现。在许多情况下,采样时钟是通过对基于数
字地的高频系统时钟分频得到的,如果将基于数字地的时钟信号传递到基于模拟地的ＡＤＣ
,两种地之间的噪声将直接叠加到时钟信号上并产生过大的抖动,这种抖动将降低ＳＮＲ并
产生不希望的谐波。可以利用ＲＦ传输与差动传输加以改善,差分接收和差分驱动应采用发
射极耦合逻辑电路(ＥＣＬ)以减小相位抖动。　　

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